應聘要求：1、碩士及以上學歷優(yōu)先，熟悉數(shù)字IC設(shè)計流程，有豐富的數(shù)字電路設(shè)計與驗證的經(jīng)驗和大規(guī)模數(shù)字電路實現(xiàn)的經(jīng)驗；2、精通掌握verilogVHDL、VHDL語言、能夠熟練運用數(shù)字電路的設(shè)計與綜合工具；3、良好的項目背景知識和技術(shù)經(jīng)驗，有圖像或視頻處理的數(shù)字設(shè)計經(jīng)驗更優(yōu)；4、扎實的電路基礎(chǔ)知識；5、良好的學習能力和創(chuàng)新能力；6、良好的溝通能力和團隊合作精神；7、有數(shù)字圖像IC設(shè)計經(jīng)驗者優(yōu)先。工作職責：1. 參與項目中數(shù)字部分功能及性能定義； 2. 項目中相關(guān)數(shù)字代碼的編寫與修改；3. 項目數(shù)字部分進度的跟進及對整體數(shù)字代碼的檢查與驗證；4. 圖像處理算法的優(yōu)化與新算法的開發(fā)；5. 項目投片回來后數(shù)字部分功能的測試與相關(guān)問題的分析與解決。
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